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功能模拟

功能模拟是直接对VHDL、原理图描述或其他描述形式的逻辑功能进行测试模拟，以了解其实现的功能是否满足原设计要求的过程，对所设计的电路及输入的原理图进行编译，检查原理图中各逻辑门或各模块的输入、输出是否有矛盾；扇入扇出是否合理；各单元模块有无未加处理的输入信号端、输出信号端，仿真过程不涉及任何具体器件的硬件特性。

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更新时间: 2016-07-06

功能模拟

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